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匿名用户
面试了职位:逻辑FPGA开发工程师
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0855
运维工程师
感觉没戏
1. JVM的内存模型
包含12个问题,4个回答
Q:1. JVM的内存模型
2 年前 发布
看准40073
FPGA开发
感觉靠谱
笔试 笔试主要考察内容范围很丰富,考察深度倒是一般。进行准备的话建议寻找历年题库,广范围的去找。 一面主要集中询问简历上的问题,项目经历之类的。项目经历会询问到很细,所以事先最好有所准备。然后会随机问一些简单的专业问题。最后会让手撕一些简单代码,难度不高。 主管面,主要问的就是你经历的最印象深刻的事情之类的问题。
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2022-08-09 发布
7520
FPGA开发
未通过
华为数通实习北京 面经先是华为机考,题比较杂,FPGA,VERILOG,还考了一些硬件的题,C语言,C++这些,很杂;接下来是面试,视频面,面试官人很nice,不知不觉就把我挂了;主要问的还是项目内容,问你的项目框架,每个部分怎么做的;我感觉我的项目可能做的比较浅,再加上我主要是做强电,感觉这种做民用产品的公司就不太能接受的样子。
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2022-06-13 发布
鸳鸯谷荧光笔酒店经理
FPGA开发
感觉没戏
挺难的
2023-08-30 发布
9351
FPGA开发
感觉没戏
SDRAM的问题,并且问题难度有所上升,又被问了读写效能的问题(这里注意,如果前面有问题没答上来,最好面试结束后去了解一下,以免被再次问到)我自然是没答上来,SDRAM设计难点主要在什么地方?刷新请求到来时,读数据处于突发模式时,数据未突发完,此时来了刷新请求,如果等待一次突发完成以后可能导致刷新请求不能得到及时的响应,这时该怎么办(一次突发如果中途被打断,会导致后面需要读写的数据丢失,所以一般等待突发结束在跳出当前状态)?然后又问了FPGA的内部组成?LE中查找表的实现原理?分布式RAM与块RAM有什么区别?查找表与触发器是怎么构成分布式RAM的?全局时钟域与局部时钟的区别?IOB的主要组成部分?建立时间不满足与保持时间不满足是由什么原因产生的,怎么解决,具体怎么做?
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2 年前 发布
看准12113
FPGA开发
确定通过
共三轮面试来学校参加的宣讲会,做的比较对口,宣讲完直接面试,面试详细问了FPGA的项目,还有时序的问题,看得出来对时序相当重视,问的问题比较基础,高校实验室做fpga项目对时序要求没ic项目那么严格,基本上能跑就行,我了解并不是很深入,但还是能回答的上来,最后聊了聊部门的研究方向,让我等二面,没多久就发二面通知了。第二天上午二面,综合面,三个面试官提问。第一个再次详细问了项目细节,以及更深入的时序约束改善问题,我感觉自己答的并不是很好,毕竟对这方面了解并不多,浅层交流还行,深入聊就聊不下去了。第二个面试官问的一些读研期间的事,论文专利,课题项目应用,不问细节,主要是问总体。第三个面试官主要是问你想不想去上海,问你家庭情况,就是看你有没有久居上海的意愿,说了加班问题,航天人要特别能吃苦,特别能奋斗,害,干这行的,哪有不加班的,只是研究所尤为夸张。面完后说等商量一下给消息。二面当天下午接到三面通知,hr面,聊薪资待遇和加班情况,这些大家都清楚,就单纯聊聊天,商量商量待遇,因为是今年秋招第一个offer,等的也很焦虑,所以没怎么为自己争取,基本说啥是啥了,现在有些后悔,感觉再谈谈更好。总体感受还不错,主要是一面技术面试官很年轻,给我的感觉也很好,可能互相之间留下的印象都比较好吧,二面其实已经被问的有点懵了,还以为机会不大,但最后还是拿到了offer,这是我面过研究所里最不水的一家,其他研究所,多的是10分钟左右面试浅浅一聊就发offer的,这点对我来说很加分,毕竟还是希望去个技术水平比较高的地方。
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2022-09-14 发布
耳东
FPGA开发
感觉靠谱
面试书写4bit超前进位加法器,逻辑表达式如下:中间变量G_i=A_i B_i, P_i=A_i⊕B_iGi=AiBi,Pi=Ai⊕Bi和:S_i=P_i⊕C_{i-1}Si=Pi⊕Ci−1,进位:C_i=G_i+P_i C_{i-1}Ci=Gi+PiCi−1。面试体验一般,需要准备笔纸
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2022-05-24 发布
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