面经详情
匿名用户
面试了职位:FPGA开发
未通过
进去要压身份证要拍照,门卫一种七十年代国企风。
进去要压身份证要拍照,门卫一种七十年代国企风。进去先去填表,居然还有党员推荐人一栏,可能我不是党员所以惊奇了。等了一个小时,前面的人面试完了,轮到了我。 面试官一个人,很nice。自我介绍,然后问你觉得自己对这个岗位有什么优势。再然后看一眼简历说我看错了,然后集体沉默了。尬聊一会就再见了。期间问了一下用的软件,运行多长时间,会配置pcie么。感觉这家公司约了好多人面试,等待期间见到很多面试的人,hr也不停在网上约人。
面试官nice
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匿名用户
FPGA开发
确定通过
目标南京展锐,十一回来,先是安排的线上笔试,题目有些难度但是问题不大,感觉你做多做多都会让你进面试的。笔试完两天通知去南大面试两轮,第一轮是HR面,就是很简单的聊了一下接触情况,由于面的比较晚所以会关注应聘者手里有什么offer。HR面完就去技术面,1v1,大概30分钟左右。问的都是基础性知识,比较简单通过。
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2 年前 发布
1
周同学
FPGA开发
确定通过
流程很快,沟通也快。笔试时间大概70分钟,两部分,第一部分是专业笔试 包含简答题和编程题,我做的慢比较匆忙;第二部分是性格测试题。一对一技术面,自我介绍,介绍一下自己最熟悉的项目,简单描述一下各个模块,哪部分设计到流水线设计,项目中遇到的困难,等等,最后反问。30min左右。一对二技术面,自我介绍,项目详细描述,各个模块,项目实现效果等等,有点忘记了,反问。自我介绍,考研成绩、为何转专业,加班的看法等。面试官都很nice。小鸟流程很快不拖拉,这点很好。总之,面试不要紧张,一定要对自己的项目熟悉。
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2022-09-24 发布
匿名用户
FPGA开发
确定通过
面试三轮吧,首先是逻辑技术大佬的技术面试,针对简历上项目详细说明和解释,这里要对自己做过的东西熟练包括一些细节。然后是部门技术总监的面试,他主要是从更宏观上问了几个问题,不难回答,也具体介绍了下公司部门团队组成。最后是HR面,相互提问交流吧,让彼此有更深的认识。她自然会问到你的离职原因啊,对上家的评价,对未来的规划,薪资期望等等。
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2 年前 发布
1
匿名用户
fpga开发工程师
确定通过
是看见了春季校园招聘会的一个展位 问了一下有没有数字ic设计的实习 结果hr恰好说有 就聊了几句 hr看着还挺精明有趣的 后来收到面试邮件 去面试时候吧 面试官年龄五十来岁 很和蔼 肯定是技术大佬 但是项目上的东西基本都没有细问 那个最相关的项目就直接就说了背景意义什么的 我也是很诧异 所以面试基本都是在闲聊 面试官还问了我课余兴趣爱好什么的 结果出来后同学告诉我面试了五十分钟 我可真能唠啊 那天我特意穿的很工科女 感觉他们是看重学历和学习能力的 和我一起面试的普通本科硕士985就没过 我是双985就过了 虽然面试官对你的技术细节不懂 但是会从和你谈话中看你是逻辑是否清晰 学习能力如何
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2 年前 发布
匿名用户
FPGA开发
确定通过
学校的推荐把简历直接发给研究所的,然后收到邮件问是否选择现场面试、远程面试等。我选择了现场面试。然后来学校面试,在学校附近的酒店。去了之后有个公司人员在一楼大厅,应该是HR,大概聊了一下,主要是公司的情况,环境薪资,待遇之类的。 然后被通知去楼上技术面。去了之后首先按照简历自我介绍了一下,我介绍的比较随意,主要把我做的项目比较细节性的说了一下。然后面试官依据我的简历情况问了一下,专业知识问的比较少,简历上的内容问的多。也问一些生活的情况。比如是不是愿意来上海,上海买房怎么办。最后一个问题问我在生活或工作中,曾经遇到的最大的问题或者挑战是什么,怎么解决的。
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包含1个问题,1个回答
Q:问我在生活或工作中,曾经遇到的最大的问题或者挑战是什么,怎么解决的。
2 年前 发布
1
匿名用户
FPGA开发
感觉没戏
技术面一般就是挖你简历,两位面试单面你一个,他们会排除你简历上的一些他们觉得有虚假的地方,建议简历不要太夸张。项目没怎么问,就是集中问了专业能力方面的,比如问你C写了多少行代码,你用到的FPGA开发过程是如何设计的,会让你手写Verilog语言代码或者C语言代码,还有问到我设计电路时分层、走线是怎么考虑的,有让画PCB层叠图综合面就很简单,会问你一些工作态度和心里素质的问题,最后问你有没有什么想提问的。
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2 年前 发布
1
6827
FPGA开发
感觉靠谱
简历投的是提前批,因为诺瓦感觉真的很不错,事实证明整个过程无论是群里HR解答问题还是面试老师都非常负责专业目前是一面,主要是问项目,问的很细,能看出来面试老师对项目中的接口协议很看重,问了网口UDP和SPI,串口等。硬件方面问了一些DDR与FPGA之间的布线规则,比如组内和组间是否需要等长处理等随后问了一些基础知识,状态机一段三段的区别,fpga内部资源,跨时钟处理方法等后半段主要问的是时序约束这一块,从基础的建立保持时间到后面的时序约束的步骤过程,然后交流了SDRAM关于使用随路时钟的可行性,面试官讲这个问题讲的很详细,后面我又请教了关于自己课题中ddr3采用什么样的方式将5路数采信号的离散数据写入以及后面如何读出,面试官老师说轮询,讲了很多,奈何自己真的菜,没听大懂
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2 年前 发布
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