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面试过程很轻松,对着简历发问
第一周接到面试通知,第二个周一去面试,然后过去了。。。面完据说还不错,让等HR通知, 然后一周过去了,没有收到HR的联系,不知道接下来会发生什么。
Q:UVM框架

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匿名用户
集成电路验证工程师
确定通过感觉靠谱
面试电话接到的比较突然,第二天下午四点开始。 由于距离北京的AMD公司比价近,所以早早的就到了,等了一会儿就和面试官见面了。由于是第一面,见面握了个手,说了声你好然后就去他们的会议室了。 面试官是个搞技术的大神,所以我不敢大肆造作,只能小心翼翼的回答。由于他们做的是SOC方面的验证,所以我就把我们做过的SOC的项目的架构给大神画了一下,大神很和蔼的听着。画完了架构就说了一下总线,总线我们用的是wishbone总线,所以就把点对点的总线给大神画了一下,然后讲解了一下各个端口的功能。大神听的津津有味,后来又说了master和slave。然后大神发问了,谁是master谁是slave,都有当master的权限么,我当时就稍微解说了一下各个外设的角色,举了个例子,采集信息的例子,然后数据和指令是怎么从内存到cpu的。再后来又举了2个例子,毕竟是验证方面的工作,怎么验证uart模块和spi模块,讲解完毕感觉自己讲的不是很好。大神也没有问那么多。后来聊了一些时序分析的知识,面试技术岗位的同学还是把自己的项目经验给说清楚吧,太重要了。基础知识也是比较重要的,数电、verilog、C语言这些。 后来我问了一些工作节奏方面的问题、加不加班啊,薪资问题啊,其实这些不应该这个时候问的,加班是我们搞技术都乐意的(这话说的不代表每一个人哈)。。我没有表达出我很愿意加班,我很愿意奉献这种心思,所以感觉面试结果不是很好。...查看更多
包含1个问题,1个回答
Q:项目当中,soc验证的例子,举两个出来,讲清楚就行。 验证项目里面你用verilog或者c写过那些testbench,讲解一下。 懂不懂UVM? 这个建议面试的同学找本书看一看,最基本的框架还是要会的,UVM的验证流程写的很清楚。 有没有做过时序分析,用什么平台做的。
2 年前 发布

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