面经详情
匿名用户
面试了职位:FPGA开发
确定通过
面试还好,不是很困难
hr电话叫去面试,先是做了几道题,难度一般;然后部门主管面试,谈了一些技术问题,个人发展期望等,由于本人当时刚毕业一年,回答的不是很流畅;面试完后让回去等二面,过了几天二面是副总面试,问了一些无关紧要的问题后,hr面,说明了一些薪资情况,然后就直接通知什么时候来上班了。轻松面过。
难度
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FPGA开发
确定通过
诺瓦一面(FPGA开发):自我介绍项目提问:1、项目用到哪些芯片,系统时钟,资源占用2、介绍下系统中用到数据缓存的模块,哪些部分在ps侧完成,3、PS和PL通信使用什么接口(axi和emio)问熟不熟悉axi44、后续如果还要优化,哪些地方可以优化5项目中遇到的难题,如何克服问的比较常规吧,结合项目来问的,可能我比较水,大概20分钟就结束了
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2 年前 发布
看准40073
FPGA开发
感觉靠谱
笔试 笔试主要考察内容范围很丰富,考察深度倒是一般。进行准备的话建议寻找历年题库,广范围的去找。 一面主要集中询问简历上的问题,项目经历之类的。项目经历会询问到很细,所以事先最好有所准备。然后会随机问一些简单的专业问题。最后会让手撕一些简单代码,难度不高。 主管面,主要问的就是你经历的最印象深刻的事情之类的问题。
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2 年前 发布
6827
FPGA开发
感觉靠谱
简历投的是提前批,因为诺瓦感觉真的很不错,事实证明整个过程无论是群里HR解答问题还是面试老师都非常负责专业目前是一面,主要是问项目,问的很细,能看出来面试老师对项目中的接口协议很看重,问了网口UDP和SPI,串口等。硬件方面问了一些DDR与FPGA之间的布线规则,比如组内和组间是否需要等长处理等随后问了一些基础知识,状态机一段三段的区别,fpga内部资源,跨时钟处理方法等后半段主要问的是时序约束这一块,从基础的建立保持时间到后面的时序约束的步骤过程,然后交流了SDRAM关于使用随路时钟的可行性,面试官讲这个问题讲的很详细,后面我又请教了关于自己课题中ddr3采用什么样的方式将5路数采信号的离散数据写入以及后面如何读出,面试官老师说轮询,讲了很多,奈何自己真的菜,没听大懂
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2 年前 发布
我有风衣
FPGA开发
感觉没戏
第一次是人事打来电话,觉得简历很匹配,说他们想找个做fpga开发的,简单介绍了下他们刚成立了个数字部门,部门这边想安排个面试,但是距离远,然后约了电话聊。人事后来确认了电话聊的时间在星期天上午10点。到了那天,一个自称数字部的人打来电话了,电话那头声音非常糟杂,也没听清他姓啥,就让我自我介绍了下,然后他开始介绍公司,说公司已经不是最初的美资控股了,最早的创始人也离职了,现在其实是国内民营资本合资控股的企业,早就不是以前老美的技术型公司了。公司就剩两样产品还在市场上卖,估计是陀螺和磁麦克风这种传感器。因为电话那头实在是太糟杂,我说了好几次听不清,这人说他换个地方,我估计他是在哪边跳广场舞呢,说是换了地方,但还是很糟杂,没想到这家企业就是这么对待面试的,也是无语。。。。好不容易听完他介绍完美新半导体公司的情况,我也很好奇,我说你们怎么会用fpga来开发产品了?这人于是又说道,其实他们不用fpga开发产品,就是想找个验证,把他们的所谓信号处理算法跑到fpga上验证,还说fpga开发很简单,其实他们自己能搞定,就是想再找个人把代码弄到fpga上。听到这,我就觉得这不是搞笑嘛,根本不懂fpga开发和算法逻辑验证,就像是凑合搭个人而已,怪不得就剩两样产品还在挣扎,作坊式的技术开发,产品的可靠性,安全性是无法保障的。这点我也顺便提了下,那人愣了一下。然后估计他觉得没面子了,说他要问个技术问题,一听就是转移话题,还想白嫖一下。他说他们最近在搭一个信号处理系统,上瑟过采样一个信号,经过埃尔法贝尔塔德尔塔调制后,问我怎么从中得到采样信号😄,不是我打错别字啊,就是这人中文+英文单词,跟我描述这个问题。上瑟?我问什么上瑟?😂,他说是磁传感器,哦哦,是sensor,不知道他的英文口音怎么读成了上的发音😂,真是太神了,我说你直接说中国话吧,传感器采样信号不就得了,上瑟!上瑟!上瑟!。。。。?😇实在是没耐心了,我说你们信号处理方式有做过验证吗?信噪比怎么样啊?行不行啊?不行的话,你就准备用fpga来做验证实现吗?这么开发怕是无法保障产品性能啊!难道一边开产品发布会,一边在后台改debug?😄结果这位数字部领导不高兴了,说岗位不适合,我说确实不适合,就这样吧。挂了电话。回头想想,我以为美新半导体是家美资企业呢,结果大跌眼镜,非常作坊,就这样的人还什么数字部领导😂😂😂,上瑟,上瑟,上瑟!记录一下面试感受,大家随便看看!就当图个乐子吧!😅,真是个做梦的公司😂😂😂
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2022-09-01 发布
木星墨水笔芯商家运营
FPGA开发
感觉靠谱
本次面试感觉很好,因为是校招宣讲会,所以是先在学校进行过初面,问了些基本的情况,比如对后续工作有什么想法,公司的基本情况有疑问嘛,期望薪资,是否留(广州发展),家里人同不同意出远门。当天下午做了个简单的技术面还是根据简历写的项目来的,会挖掘的很深,主要还是面试官想了解你会什么以及你会的跟他们做的产品是否相关总体不错。
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2023-03-18 发布
4698
FPGA开发
确定通过
一面 一面的话是技术面,主要是自我介绍之后,聊简历内容,介绍项目比赛情况,项目难点,目前的商业化的和实验室的差距在哪里,一些专业知识的回答技术主管面,自我介绍,聊简历内容,介绍项目比赛情况,项目难点,画项目框图,问了GTH接口的速率,然后卷积模块内容,以及DSP+SRIO口的内容,讲一下论文内容,创新点是什么,职场规划,对公司的看法,以及日常生活,课外生活,对老师的看法
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2 年前 发布
周同学
FPGA开发
确定通过
流程很快,沟通也快。笔试时间大概70分钟,两部分,第一部分是专业笔试 包含简答题和编程题,我做的慢比较匆忙;第二部分是性格测试题。一对一技术面,自我介绍,介绍一下自己最熟悉的项目,简单描述一下各个模块,哪部分设计到流水线设计,项目中遇到的困难,等等,最后反问。30min左右。一对二技术面,自我介绍,项目详细描述,各个模块,项目实现效果等等,有点忘记了,反问。自我介绍,考研成绩、为何转专业,加班的看法等。面试官都很nice。小鸟流程很快不拖拉,这点很好。总之,面试不要紧张,一定要对自己的项目熟悉。
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2022-09-24 发布
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