面经详情
3113
面试了职位:FPGA开发
确定通过
FPGA开发面试一般,共3轮面试
网申,性格测试,机试,面试
性格测试网上有经验传授,前后一致就行
机试是范围比较广的硬件逻辑题,基本都是选择题
面试会问简历上有的项目经历
有网申
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网络工程师
感觉靠谱
一面 先是自我介绍,会针对你简历中的项目进行追问,
包含7个问题,4个回答
Q:项目中用到的技术,
2 年前 发布
9351
FPGA开发
感觉没戏
SDRAM的问题,并且问题难度有所上升,又被问了读写效能的问题(这里注意,如果前面有问题没答上来,最好面试结束后去了解一下,以免被再次问到)我自然是没答上来,SDRAM设计难点主要在什么地方?刷新请求到来时,读数据处于突发模式时,数据未突发完,此时来了刷新请求,如果等待一次突发完成以后可能导致刷新请求不能得到及时的响应,这时该怎么办(一次突发如果中途被打断,会导致后面需要读写的数据丢失,所以一般等待突发结束在跳出当前状态)?然后又问了FPGA的内部组成?LE中查找表的实现原理?分布式RAM与块RAM有什么区别?查找表与触发器是怎么构成分布式RAM的?全局时钟域与局部时钟的区别?IOB的主要组成部分?建立时间不满足与保持时间不满足是由什么原因产生的,怎么解决,具体怎么做?
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2 年前 发布
看准62029
FPGA开发
感觉没戏
自我介绍3分钟;专业问答:1.你自我介绍讲了因为课题项目接触FPGA,除此之外,你个人角度对FPGA有没有什么兴趣和接触。2.简历上的项目是你做过最复杂的项目了吗,有没有做过其他项目。3.讲一下你项目中遇到的问题。4.项目过程中用到了xlinx的哪些IP核5.项目时钟有几个,频率是多少。6.项目调试有哪些步骤,你是怎么做的。7.有了解过什么输入输出协议吗。8.你是什么时候学的数字电路,如果要你将一个时钟分频出3分之一的时钟要怎么做。思路:二分频:每次原时钟上升沿时,从时钟取反。四分频:设置一个两位的计数器,原时钟跳变一次计数一次,计数循环顺序00->01->10->11->00,每次计数器取到00时从时钟跳变。八分频:同四分频,每计数8次跳变一次。三分频:设置两个二分频从时钟,一个监测原时钟上升沿,一个监测下降沿,最后两个从时钟相或得到三分频时钟。9.你说的四大件有哪些,对于冒泡算法有了解吗,时间复杂度是多少。10. 还有了解其他排序算法吗,快速排序的复杂度是多少。11. 你学过C语言吗,使用C语言写_____会吗。个人方面:1.你是哪里人,你什么时候开始了解FPGA的,FPGA能用在什么地方。2.知道我们公司主要业务吗,期望的岗位是什么。3.你有什么想问我们的:工作地点在哪;如果能进入贵司,会有导师带领学习吗。
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2022-09-05 发布
鸳鸯谷荧光笔酒店经理
FPGA开发
感觉没戏
挺难的
2023-08-30 发布
7520
FPGA开发
未通过
华为数通实习北京 面经先是华为机考,题比较杂,FPGA,VERILOG,还考了一些硬件的题,C语言,C++这些,很杂;接下来是面试,视频面,面试官人很nice,不知不觉就把我挂了;主要问的还是项目内容,问你的项目框架,每个部分怎么做的;我感觉我的项目可能做的比较浅,再加上我主要是做强电,感觉这种做民用产品的公司就不太能接受的样子。
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2 年前 发布
看准40073
FPGA开发
感觉靠谱
笔试 笔试主要考察内容范围很丰富,考察深度倒是一般。进行准备的话建议寻找历年题库,广范围的去找。 一面主要集中询问简历上的问题,项目经历之类的。项目经历会询问到很细,所以事先最好有所准备。然后会随机问一些简单的专业问题。最后会让手撕一些简单代码,难度不高。 主管面,主要问的就是你经历的最印象深刻的事情之类的问题。
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2022-08-09 发布
耳东
FPGA开发
感觉靠谱
面试书写4bit超前进位加法器,逻辑表达式如下:中间变量G_i=A_i B_i, P_i=A_i⊕B_iGi=AiBi,Pi=Ai⊕Bi和:S_i=P_i⊕C_{i-1}Si=Pi⊕Ci−1,进位:C_i=G_i+P_i C_{i-1}Ci=Gi+PiCi−1。面试体验一般,需要准备笔纸
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2 年前 发布
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